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Projet de theremin numérique sur un FPGA
Il est possible d'utiliser les bits inutilisé de la phase pour faire une interpolation linéaire entre deux élément du sinus
La partie amplitude est faite un peu à l'arrache.
Il faudrait verififer son fonctionnement, en particulier avec les valeurs extrêmes en entrée: -32768 -32767, -1, 0, 1, -32767
Pour l'instant les LUT générée sont asynchrone.
Il serait peut-être bien qu'elle soit synchrone, avec une entrée clock.
Il serait peut-être judicieux d'utiliser directement les block de ram pour l'implémentation des LUT.
D’après la doc du cs4344 et les specification du protocole I2S, le MSB doit être envoyé avec un cycle de SCLK après le changement de LRCK.
Le code du prof envoie le MSB direct au changement de LRCK.
Il faudrait aussi vérifier l'histoire des entrée/sortie pmod inversée.
Je suis pas sur que se soit vraiment utile.
Générer un son avec une fréquence trop élevée pour la sortie donne peut-être des effets sympa, à tester.
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